積和演算回路及びその方法

Product sum calculation circuit and method therefor

Abstract

<P>PROBLEM TO BE SOLVED: To provide a miniaturized product sum calculation circuit with low power consumption. <P>SOLUTION: The product sum arithmetic circuit includes a pulse-width digital conversion circuit 9 for converting a pulse signal having a pulse width representing an operand value; a sorting block 4 for outputting a plurality of operand values Xi being converted into the digital signals by the pulse-width digital conversion circuit 9 in either ascending or descending order; and an calculation block 1 for multiplying each operand value being output from the sorting block 4 by corresponding operation values Wi, and calculating an accumulation sum of the multiplied results. The pulse-width digital conversion circuit 9 further includes a counter 10 for counting clocks and outputting the count value as a digital signal, and n termination latch circuits 11-0 to 11-(n-1) for latching the common count values being output from the counter at the end edge of each input pulse signal. <P>COPYRIGHT: (C)2005,JPO&NCIPI
【課題】 低消費電力かつ小型の積和演算回路を提供する。 【解決手段】 積和演算回路に、被演算値を表わすパルス幅を持つパルス信号をデジタル信号に変換するパルス幅・デジタル変換回路9と、パルス幅・デジタル変換回路9によりデジタル信号に変換された複数の被演算値Xiを降順または昇順に出力するソーティングブロックと、ソーティングブロック4より出力される各被演算値に対応する演算値Wiを乗じ、乗算結果の累算和を算出する演算ブロック1とを備え、パルス幅・デジタル変換回路9が、クロックを計数してその計数値をデジタル信号として出力するカウンタ10と、それぞれに入力される各パルス信号の終端において前記カウンタが出力する共通の計数値をラッチするn個の終端ラッチ回路11−0〜11−(n-1)とを有する。 【選択図】 図6

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